Pacote: python3-verilog-parser (0.0.7-1)

[ Fonte: verilog-parser  ]

Parser for Verilog netlists (structural Verilog)

Lark based parser for Verilog netlists (structural Verilog without behavioral statements). This is meant to be used to read netlists as generated by HDL logic synthesizers such as Yosys.

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