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Paquet : covered (0.7.10-3 et autres)

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outil d’analyse de couverture de code Verilog

Covered est un utilitaire de couverture de code Verilog qui lit une conception Verilog et un fichier généré de vidage VCD/LXT, et crée un fichier de couverture pouvant être fusionné avec d’autres fichiers ou utilisé pour générer un rapport de couverture. Covered fournit aussi un utilitaire graphique de rapport de couverture qui lit dans un fichier de couverture pour permettre une exploration interactive de couverture. Les domaines de couverture mesurés par Covered sont la couverture de lignes, de bascules, de mémoires, de logique combinatoire, les transitions d’état à état de machine à états fines et les assertions.

Étiquettes: Domaine: Électronique, Mis en œuvre en: C, Interface utilisateur: interface::commandline, interface::graphical, Système X Window, Rôle: Programme, Boîte à outils d'interface utilisateur: uitoolkit::tk, use::viewing, Système X Window: Application

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Architecture Version Taille du paquet Espace occupé une fois installé Fichiers
amd64 0.7.10-3+b1 531,1 ko2 394,0 ko [liste des fichiers]
arm64 0.7.10-3+b1 433,3 ko2 254,0 ko [liste des fichiers]
armhf 0.7.10-3+b1 461,0 ko1 813,0 ko [liste des fichiers]
i386 0.7.10-3+b1 536,5 ko2 537,0 ko [liste des fichiers]